用于编解码器的环内滤波器及滤波方法与流程

电子通信装置的制造及其应用技术1.本公开涉及视频编解码领域，具体地，涉及一种用于编解码器的环内滤波器及滤波方法。背景技术：2.h.264是国际标准化组织(iso)和国际电信联盟(itu)共同提出的继mpeg4之后的新一代数字视频压缩格式。在h.264中，由于帧内和帧间预测残差的离散余弦变换(discrete cosine transform，dct)量化过程相对粗糙，所以反量化过程恢复的变换系数带有误差，造成图像块在边界上视觉的不连续，使得编解码器反变换量化后的图像中出现小方块，而且小方块在边界处呈现不连续的效果，这种现象称为方块效应。3.目前，通常是在h.264中引入环路滤波器来对块边界进行滤波以提高图像的主客观评价质量水平来消除方块效应，而引入高度自适应的环路滤波器，会使得算法的复杂度大大增加，简化硬件结构来降低算法度复杂度进而高效去除方块效应是本领域技术人员亟待解决的问题。技术实现要素：4.本公开的目的是提供一种用于编解码器的环内滤波器及滤波方法，能够采用简单的硬件结构高效去除方块效应。5.根据本公开的第一实施例，提供一种用于编解码器的环内滤波器，包括：输入存储器，用于存储待去方块宏块的各个子块的数据；缓存存储器，用于存储所述待去方块宏块的左边界邻接子块和上边界邻接子块的数据，以及存储周边宏块控制信息；输出存储器，用于存储对所述待去方块宏块的各个子块执行滤波处理后的最终数据；预取模块，用于从所述输入存储器中流水线地读取所述待去方块宏块的当前要被滤波处理的子块的数据，以及在所述当前要被滤波处理的子块是所述待去方块宏块的边界子块的情况下，还从所述缓存存储器中流水线地读取相应的左边界邻接子块的数据和/或相应的上边界邻接子块的数据；去方块模块，用于基于所述周边宏块控制信息和所述预取模块读取的数据，对所述待去方块宏块的各个子块流水线地执行所述滤波处理；以及输出模块，用于将所述滤波处理后的最终数据流水线地写入所述输出存储器。6.可选地，所述滤波处理包括依次执行的第一滤波处理和第二滤波处理，其中，所述第一滤波处理是垂直滤波处理和水平滤波处理中的一者，所述第二滤波处理是所述垂直滤波处理和所述水平滤波处理中的另一者；则：所述输出模块，用于将所述第一滤波处理后的中间数据流水线地写入所述缓存存储器，将所述第二滤波处理后的最终数据流水线地写入所述输出存储器；所述输出存储器，用于存储对所述待去方块宏块的各个子块执行所述第二滤波处理后的最终数据；所述缓存存储器，还用于存储对所述待去方块宏块的各个子块执行所述第一滤波处理后的中间数据；所述预取模块，还用于在所述第二滤波处理被执行之前，从所述缓存存储器中流水线地读取所述当前要被滤波处理的子块的、第一滤波处理后的中间数据，作为所述当前要被滤波处理的子块的数据。7.可选地，所述预取模块包括第一寄存器组和第二寄存器组，其中：所述第一寄存器组和所述第二寄存器组，用于在对所述待去方块宏块的左边界子块和上边界子块执行所述滤波处理的情况下，对相应的左边界子块的数据、相应的上边界子块的数据、相应的左边界邻接子块的数据和相应的上边界邻接子块的数据进行寄存；所述第二寄存器组，还用于在对所述左边界子块和所述上边界子块之外的子块执行所述滤波处理的情况下，对所述左边界子块和所述上边界子块之外的子块的数据进行寄存。8.可选地，所述去方块模块包括第三寄存器组、第四寄存器组和去方块运算模块，其中：所述第四寄存器组，用于对来自所述第二寄存器组的数据进行寄存；所述第三寄存器组，用于在所述左边界子块和所述上边界子块被滤波处理的情况下，对来自所述第一寄存器组的数据进行寄存，以及在所述左边界子块和所述上边界子块之外的子块被滤波处理的情况下，对所述去方块运算模块的p结果进行寄存；所述去方块运算模块，用于基于所述第三寄存器组和所述第四寄存器组寄存的数据，对所述待去方块宏块的各个子块进行所述滤波处理。9.可选地，所述输出模块包括第五寄存器组和第六寄存器组，其中：所述第五寄存器组，用于对所述去方块运算模块的p结果进行寄存并流水线地输出；以及所述第六寄存器组，用于对所述去方块运算模块的q结果进行寄存并流水线地输出，而且，所述第六寄存器组仅在对所述待去方块宏块的右边界子块和下边界子块进行所述滤波处理的情况下才有效。10.可选地，所述去方块模块用于按照以下顺序对所述待去方块宏块的各个子块进行滤波处理：先对所述待去方块宏块的亮度进行垂直滤波，然后对所述亮度进行水平滤波，然后对所述待去方块宏块的色度cb和色度cr进行垂直滤波，最后对所述色度cb和所述色度cr进行水平滤波。11.可选地，所述环内滤波器还包括读写控制模块和缓存访问模块，其中，所述读写控制模块用于在所述滤波处理被执行之前控制所述缓存访问模块读取出所述缓存存储器中存储的所述周边宏块控制信息，在所述滤波处理被执行之后控制所述缓存访问模块将后续所需的周边宏块控制信息写入所述缓存存储器。12.可选地，所述读写控制模块，还用于在所述预取模块从所述缓存存储器中读取数据的操作和所述输出模块向所述缓存存储器中写入数据的操作同时有效的情况下，控制所述输出模块的写入数据连同地址信息被一起保存在所述缓存访问模块的写缓冲区中，并在所述预取模块从所述缓存存储器中读取数据的操作无效时，控制所述写缓冲区中的数据被填入到所述缓存存储器中。13.可选地，所述缓存存储器为单口片内随机存取存储器。14.可选地，所述垂直滤波按照垂直边界在水平方向增长的顺序执行，所述水平滤波按照水平边界在垂直方向增长的顺序执行。15.根据本公开的第二实施例，提供一种用于编解码器的环内滤波方法，包括：从输入存储器中流水线地读取待去方块宏块的当前要被滤波处理的子块的数据，以及在所述当前要被滤波处理的子块是所述待去方块宏块的边界子块的情况下，还从缓存存储器中流水线地读取相应的左边界邻接子块的数据和/或相应的上边界邻接子块的数据；基于所述缓存存储器中存储的周边宏块控制信息和所述预取模块读取的数据，对所述待去方块宏块的各个子块流水线地执行所述滤波处理；将滤波处理后的最终数据流水线地写入输出存储器。16.可选地，17.对待去方块宏块的各个子块进行滤波处理，包括：先对待去方块宏块的亮度进行垂直滤波，然后对亮度进行水平滤波，然后对待去方块宏块的色度cb和色度cr进行垂直滤波，最后对色度cb和色度cr进行水平滤波。18.可选地，根据本公开实施例的方法还包括：在所述滤波处理被执行之前控制所述缓存存储器中存储的所述周边宏块控制信息的读出，在所述滤波处理被执行之后控制将后续所需的周边宏块控制信息写入所述缓存存储器。19.可选地，根据本公开实施例的方法还包括：在从所述缓存存储器中读取数据的操作和向所述缓存存储器中写入数据的操作同时有效的情况下，控制写入数据连同地址信息被一起保存在写缓冲区中，并在从所述缓存存储器中读取数据的操作无效时，控制所述写缓冲区中的数据被填入到所述缓存存储器中。20.通过采用上述技术方案，由于预取模块流水线地从输入存储器和缓存存储器中读取数据、去方块模块流水线地对预取模块读取的数据执行滤波处理、输出模块流水线地输出滤波处理后的最终数据，因此，通过这种流水线的形式使得每一流水线级均具有各自固定的时间处理片刻，例如每一流水线可以具有相同的固定的时间处理片刻，从而使得每一级流水线不会造成拥塞，提升了整个滤波处理的性能。21.本公开的其他特征和优点将在随后的具体实施方式部分予以详细说明。附图说明22.附图是用来提供对本公开的进一步理解，并且构成说明书的一部分，与下面的具体实施方式一起用于解释本公开，但并不构成对本公开的限制。在附图中：23.图1是根据本公开一种实施例的用于编解码器的环内滤波器的示意框图。24.图2是示例性的待去方块宏块的示意图。25.图3示出了4×4宏块的亮度、色度cb和色度cr的示意图。26.图4示出了根据本公开实施例的流水线处理方式的示意图。27.图5是亮度宏块的去方块周边数据及滤波顺序示意图。28.图6是根据本公开实施例的又一环内滤波器的示意框图。29.图7是根据本公开一种实施例的用于编解码器的环内滤波方法的流程图。具体实施方式30.以下结合附图对本公开的具体实施方式进行详细说明。应当理解的是，此处所描述的具体实施方式仅用于说明和解释本公开，并不用于限制本公开。31.图1是根据本公开一种实施例的用于编解码器的环内滤波器的示意框图。如图1所示，该环内滤波器100包括输入存储器1、缓存存储器2、输出存储器3、预取模块4、去方块模块5和输出模块6。32.输入存储器1，用于存储待去方块宏块的各个子块的数据。33.待去方块宏块指的是需要被去除方块效应(也即需要被滤波处理)的宏块。34.缓存存储器2，用于存储待去方块宏块的左边界邻接子块和上边界邻接子块的数据，以及存储周边宏块控制信息。以图2所示的示例性待去方块宏块为例进行说明，其中，待去方块宏块包括编号为0-15的子块，而t0-t3以及l0-l3则是待去方块宏块的周边宏块的子块。以图2为例，缓存存储器2中会存储待去方块宏块的左边界邻接子块l0-l3以及上边界邻接子块t0-t3的数据。35.周边宏块控制信息是指之前解码出来的关于宏块的一些控制信息，例如，关于是帧内预测宏块还是帧间预测模块的信息、关于是否为脉冲编码调制(pulse code modulation，pcm)块的信息、关于对应的4×4子块是否包括非零系数的信息，等等。这些周边宏块控制信息是用来计算滤波的边界强度的。36.输出存储器3，用于存储对待去方块宏块的各个子块执行滤波处理后的最终数据。37.在本公开中，各个存储器可以是随机存取存储器或者其他类型的存储器。38.预取模块4，用于从输入存储器1中流水线地读取待去方块宏块的当前要被滤波处理的子块的数据，以及在当前要被滤波处理的子块是待去方块宏块的边界子块的情况下，还从缓存存储器2中流水线地读取相应的左边界邻接子块的数据和/或相应的上边界邻接子块的数据。39.仍然以图2所示的待去方块宏块为例，如果当前要被滤波处理的子块是子块0，则预取模块4会从输入存储器1中流水线地读取子块0的数据，而且由于子块0是待去方块宏块的边界子块，所以在对子块0执行垂直滤波处理时，预取模块4还会从缓存存储器2中流水线地读取左边界邻接子块l0的数据，在对子块0执行水平滤波处理时，预取模块4还会从缓存存储器2中流水线地读取上边界邻接子块t0的数据。如果当前要被滤波处理的子块是子块5，则预取模块4只需要从输入存储器1中流水线地读取子块5的数据就可以了。也即，只有在对待去方块宏块的左边界子块和上边界子块执行滤波处理的情况下，才需要读取相应的左边界邻接子块、相应的上边界邻接子块的数据。40.去方块模块5，用于基于周边宏块控制信息和预取模块4读取的数据，对待去方块宏块的各个子块流水线地执行滤波处理。41.输出模块6，用于将滤波处理后的最终数据流水线地写入输出存储器3。42.通过采用上述技术方案，由于预取模块4流水线地从输入存储器1和缓存存储器2中读取数据、去方块模块5流水线地对预取模块4读取的数据执行滤波处理、输出模块6流水线地输出滤波处理后的最终数据，因此，通过这种流水线的形式使得每一流水线级均具有各自固定的时间处理片刻，例如每一流水线可以具有相同的固定的时间处理片刻，从而使得每一级流水线不会造成拥塞，提升了整个滤波处理的性能。43.在一个实施例中，滤波处理可以包括依次执行的第一滤波处理和第二滤波处理，其中，第一滤波处理是垂直滤波处理和水平滤波处理中的一者，第二滤波处理是垂直滤波处理和水平滤波处理中的另一者。则，在这种情况下：44.输出模块6，用于将第一滤波处理后的中间数据流水线地写入缓存存储器，将所述第二滤波处理后的最终数据流水线地写入所述输出存储器；45.输出存储器3，用于存储对待去方块宏块的各个子块执行第二滤波处理后的最终数据；46.缓存存储器2，还用于存储对待去方块宏块的各个子块执行第一滤波处理后的中间数据；47.预取模块4，还用于在第二滤波处理被执行之前，从缓存存储器2中流水线地读取当前要被滤波处理的子块的、第一滤波处理后的中间数据，作为当前要被滤波处理的子块的数据。48.通过上述技术方案，由于第一滤波处理后的数据被存储在了缓存存储器2中，这样在执行第二滤波处理时，就可以从缓存存储器中预取所需的数据，而无需再次读取输入存储器1，从而减小了预读取所需的带宽。49.在一个实施例中，去方块模块5可以按照以下顺序对待去方块宏块进行垂直滤波和水平滤波：先对待去方块宏块的亮度进行垂直滤波，然后对亮度进行水平滤波，然后对待去方块宏块的色度cb和色度cr进行垂直滤波，最后对色度cb和色度cr进行水平滤波。其中，垂直滤波按照垂直边界在水平方向增长的顺序执行，水平滤波按照水平边界在垂直方向增长的顺序执行。这样就能够减小数据对外部存储器数据读取的需求。图3示出了4×4宏块的亮度、色度cb和色度cr的示意图。图3中，浅灰色区域表示待去方块宏块，深灰色区域表示待去方块宏块的周边宏块，图中的数字是待去方块宏块的子块的各个边界的编号。50.图4示出了根据本公开实施例的流水线处理方式的示意图。如图4所示，首先，预取模块4在预取0阶段从相应的存储器中预取相应的数据；然后，在预取模块4执行预取1阶段期间，去方块模块5会执行去方块0阶段，以对预取0阶段读取的数据进行滤波处理；然后，在预取模块4执行预取2阶段期间，去方块模块5会执行去方块1阶段，以对预取1阶段读取的数据进行滤波处理，而在这期间，输出模块6会执行输出0阶段以将去方块0阶段得到的滤波数据进行输出。也即，预取模块4、去方块模块5和输出模块6均是以流水线的方式进行操作。51.下面结合图5对预取模块4的预取流水线操作进行详细描述，其中，图5是亮度宏块的去方块周边数据及滤波顺序示意图。52.在垂直滤波预取块计数为预取0阶段，读取左边界邻接子块l0的数据和待去方块宏块的子块0的数据。若预取子状态为0，则从缓存存储器2读取左边界邻接子块l0的第一第二行，若预取子状态为1，则从缓存存储器2读取左边界邻接子块l0的第三第四行。若预取子状态为0，则从输入存储器1读取子块0的第0行，若预取子状态为1，则从输入存储器1读取子块0的第1行，若预取子状态为2，则从输入存储器1读取子块0的第2行，若预取子状态为3，则从输入存储器1读取子块0的第3行。在垂直滤波预取块计数为预取1阶段，待去方块宏块的子块1的读取，与预取0阶段子块0的读取类似，也即，分4个周期从输入存储器1读取子块1的4行数据。其他子块的读取以此类推。53.在水平滤波预取块计数为预取0阶段，由于垂直滤波后的数据都存放在缓存存储器2中以减小预读取的带宽，所以上边界邻接子块t0的数据和子块0的数据都是从缓存存储器2中读取的。则，由于数据存储的格式，一个周期可以读回两行数据，所以，若预取子状态为0，则从缓存存储器2中读取子块0的第一第二行，若预取子状态为1，则从缓存存储器2中读取子块0的第三第四行，若预取子状态为3，则从缓存存储器2中读取上边界邻接子块t0的第一第二行，若预取子状态为1，则从缓存存储器2中读取上边界邻接子块t0的第三第四行。除了上边界，水平滤波只需要预取子状态0和预取子状态1。54.接下来仍然结合图5描述输出模块6的输出流水级操作。55.当完成边界0时，将块l0写入到输出存储器3中；当完成边界1时，将块0写入到缓存存储器2的垂直结果区域中；当完成边界2时，将块1写入到缓存存储器2的垂直结果区域中；当完成边界3时，将块2写入到缓存存储器2的垂直结果区域中，同时将块3写入到缓存存储器2的垂直结果区域中。依次完成整个宏块的垂直滤波输出。56.当完成边界16时，将块t0写入到输出存储器3中；当完成边界17时，将块0写入到输出存储器3中；当完成边界18时，将块4写入到输出存储器3中；当完成边界19时，将块8写入到输出存储器3中，同时将块12写入到缓冲存储器2的上边界存储中。依次完成整个宏块的水平滤波输出。57.通过这种流水线的方式，可以使得预取流水级完成对一个滤波边界对应p块与q块数据以及信息的提取，去方块处理流水级完成对一个边界进行滤波计算，输出流水级完成一个完成滤波处理的数据的回写，例如，将垂直滤波完成的数据回写至缓存存储器2中，将水平滤波完成的数据回写至输出存储器3中。而且，每一级流水级可以采用相等的工作周期(当然，不同工作周期也是可行的)，使得每一级流水线不会造成拥塞，提升了整个滤波处理的性能。根据去方块使用的行计算单元，流水级的工作周期可以为4个周期～7个周期，可分别应用于不同需求的应用场合。58.每一级流水线可以分别拥有两个寄存器组，分别用于当前一级流水的处理，如图6的根据本公开实施例的又一环内滤波器的示意框图所示。59.如图6所示，预取模块4包括第一寄存器组41和第二寄存器组42。60.第一寄存器组41和第二寄存器组42，均用于在对待去方块宏块的左边界子块和上边界子块执行滤波处理的情况下，对相应的左边界子块的数据、相应的上边界子块的数据、相应的左边界邻接子块的数据和相应的上边界邻接子块的数据进行寄存。以图2所示的待去方块宏块为例，在对左边界子块4执行垂直滤波的情况下，第一寄存器组41和第二寄存器组42均用于对子块l1的数据和子块4的数据进行寄存。61.除此之外，第二寄存器组42还用于在对待去方块宏块的左边界子块和上边界子块之外的子块执行滤波处理的情况下，对左边界子块和上边界子块之外的子块的数据进行寄存。以图2所示的待去方块宏块为例，在对待去方块宏块的子块5进行滤波处理的情况下，第二寄存器组42会对子块5的数据进行寄存，而此时第一寄存器组41并未被使用。也就是说，在整个滤波处理过程期间，第二寄存器组42一直都在工作，每次都是用来存放当前待滤波子块的数据；而第一寄存器组41只有在对左边界和上边界滤波的情况下才会被使用以存放相应相邻子块的数据。62.通过第一寄存器组41和第二寄存器组42对滤波处理所需的当前一级流水数据进行寄存，就能够减小对预读取数据的带宽的需求，使得每一级流水不会造成拥塞，提升整个滤波处理的性能。63.继续参考图6，去方块模块5包括第三寄存器组51、第四寄存器组52和去方块运算模块53。64.第四寄存器组52，用于对来自第二寄存器组42的数据进行寄存。65.第三寄存器组51，用于在待去方块宏块的左边界子块和上边界子块被滤波处理的情况下，对来自第一寄存器组41的数据进行寄存，以及在待去方块宏块的左边界子块和上边界子块之外的子块被滤波处理的情况下，对去方块运算模块53的p结果进行寄存以便在下一条边界的滤波时使用。66.去方块运算模块53，用于基于第三寄存器组51和第四寄存器组52的数据，对待去方块宏块的各个子块进行滤波处理，例如进行垂直滤波和水平滤波。67.通过第三寄存器组51和第四寄存器组52对滤波处理所需的当前一级流水数据进行寄存，就能够减小对预读取数据的带宽的需求，使得每一级流水不会造成拥塞，提升整个滤波处理的性能。68.继续参考图6，输出模块6包括第五寄存器组61和第六寄存器组6。第五寄存器组61，用于对去方块运算模块53的p结果进行寄存并流水线地输出；以及第六寄存器组62，用于对去方块运算模块53的q结果进行寄存并流水线地输出，而且，第六寄存器组62仅在对待去方块宏块的右边界子块和下边界子块进行滤波处理的情况下才有效。69.通过第五寄存器组61和第六寄存器组62对数据的寄存，就能够使得输出流水级不会造成拥塞，提升整个滤波处理的性能。70.上述各个寄存器组的阵列大小根据待去方块宏块的阵列大小来确定，例如，如果待去方块宏块的阵列大小是4×4，那么上述各个寄存器就可以是4×4的寄存器组。71.通过采用上述技术方案，每一级流水线均拥有两个寄存器组，分别用于当前一级流水的处理，使得每一级流水线不会造成拥塞，提升了整个滤波处理的性能。而且，除待去方块宏块的左边界和上边界外，每个流水时间片只需读取一个寄存器组数据，另一个寄存器组由上一次运算结果获得，减少预读取数据的带宽需求。72.继续参考图6。根据本公开实施例的环内滤波器100还可以包括读写控制模块7和缓存访问模块8。缓存访问模块8用于产生存储器的读写控制信号，以写入和读取缓存存储器2中的数据。读写控制模块7用于在滤波处理被执行之前控制缓存访问模块8读取出缓存存储器2中存储的周边宏块控制信息，在滤波处理被执行之后控制缓存访问模块8将后续所需的周边宏块控制信息写入缓存存储器2中。通过这种分时复用的方式，就能够避免缓存存储器2的读写冲突，解决了采用一块单口片内存储器作为缓存存储器2来存储缓存数据信息时的读写冲突问题。而采用一块单口片内存储器作为缓存存储器2，则能够减小环内滤波器的面积，降低成本。73.在又一实施例中，读写控制模块7，还用于在预取模块4从缓存存储器2中读取数据的操作和输出模块6向缓存存储器2中写入数据的操作同时有效的情况下，控制输出模块6的写入数据连同地址信息被一起保存在缓存访问模块8的写缓冲区中，并在预取模块4从缓存存储器2中读取数据的操作无效时，控制写缓冲区中的数据被填入到缓存存储器2中。其中，写缓冲是一组寄存器组成的先进先出(first input first output，fifo)存储区，在读写冲突的时候缓冲写数据。通过如此配置，就能够解决滤波数据的读写冲突问题。74.表1是文献《a near optimal deblocking filter for h.264 advanced video coding》中列举的多种设计方案以及本公开的方案的性能和面积对比。从表中可以看出，本公开设计的环内滤波器电路结构比现有方案在性能和面积上都有很大优势，而且仅有一块存储器，更大程度降低设计电路面积。[0075][0076]表1[0077]图7是根据本公开一种实施例的用于编解码器的环内滤波方法的流程图。如图7所示，该方法包括以下步骤s71至s73。[0078]在步骤s71中，从输入存储器中流水线地读取待去方块宏块的当前要被滤波处理的子块的数据，以及在所述当前要被滤波处理的子块是所述待去方块宏块的边界子块的情况下，还从缓存存储器中流水线地读取相应的左边界邻接子块的数据和/或相应的上边界邻接子块的数据；[0079]在步骤s72中，基于所述缓存存储器中存储的周边宏块控制信息和所述预取模块读取的数据，对所述待去方块宏块的各个子块流水线地执行所述滤波处理；[0080]在步骤s73中，将滤波处理后的最终数据流水线地写入输出存储器。[0081]通过采用上述技术方案，由于能够流水线地预取数据、流水线地执行滤波处理和流水线地输出滤波处理后的数据，因此使得每一流水线级均具有各自固定的时间处理片刻，例如每一流水线可以具有相同的固定的时间处理片刻，从而使得每一级流水线不会造成拥塞，提升了整个滤波处理的性能。[0082]可选地，对待去方块宏块的各个子块进行滤波处理，包括：先对待去方块宏块的亮度进行垂直滤波，然后对亮度进行水平滤波，然后对待去方块宏块的色度cb和色度cr进行垂直滤波，最后对色度cb和色度cr进行水平滤波。[0083]可选地，根据本公开实施例的方法还包括：在所述滤波处理被执行之前控制所述缓存存储器中存储的所述周边宏块控制信息的读出，在所述滤波处理被执行之后控制将后续所需的周边宏块控制信息写入所述缓存存储器。[0084]可选地，根据本公开实施例的方法还包括：在从所述缓存存储器中读取数据的操作和向所述缓存存储器中写入数据的操作同时有效的情况下，控制写入数据连同地址信息被一起保存在写缓冲区中，并在从所述缓存存储器中读取数据的操作无效时，控制所述写缓冲区中的数据被填入到所述缓存存储器中。[0085]关于上述实施例中的方法，其中各个步骤执行操作的具体方式已经在有关该装置的实施例中进行了详细描述，此处将不做详细阐述说明。[0086]以上结合附图详细描述了本公开的优选实施方式，但是，本公开并不限于上述实施方式中的具体细节，在本公开的技术构思范围内，可以对本公开的技术方案进行多种简单变型，这些简单变型均属于本公开的保护范围。[0087]另外需要说明的是，在上述具体实施方式中所描述的各个具体技术特征，在不矛盾的情况下，可以通过任何合适的方式进行组合。为了避免不必要的重复，本公开对各种可能的组合方式不再另行说明。[0088]此外，本公开的各种不同的实施方式之间也可以进行任意组合，只要其不违背本公开的思想，其同样应当视为本公开所公开的内容。









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